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Posté par martoni (site web personnel, Mastodon) le 24 septembre 2018 à 09:48. En réponse à la dépêche Verilator 4.002. Évalué à 4.
J'ai rebooté le projet verilator VHDL et je serais curieux d'avoir des testeurs :)
Cool, il faut que j'aille voir ça !
J'ai plus qu'une balle
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[^] # Re: Pourquoi seulement du Verilog synthétisable ?
Posté par martoni (site web personnel, Mastodon) . En réponse à la dépêche Verilator 4.002. Évalué à 4.
Cool, il faut que j'aille voir ça !
J'ai plus qu'une balle