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【Zynq】最后发表: 2020年03月07日 20:44:38 by xbs2023 |
【开发工具与评估板】最后发表: 2020年02月27日 19:22:39 by xbs2020 |
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使用 Virtex-5 FPGA 器件实现 DDR SDRAM 控制器(中文版) | Rancho | 2570/3 | 2018年09月30日 14:45:16 by 账号 |
virtex5 中文手册 | GONGCHK | 3215/6 | 2018年09月29日 10:41:18 by yaloo2011 |
【Nexys3】难得的数字电路实验原始工程文件_Lab15_sw2reg.rar | 583199723 | 11226/20 | 2018年09月29日 10:28:47 by yaloo2011 |
windows xp系统pcie的dma读写无完成中断 | lisic | 1301/0 | 2018年09月06日 13:24:50 by lisic |
关于带PCIE-DMA ip核在windows XP下无法启动 | q250891510 | 2203/1 | 2018年09月06日 11:01:11 by lisic |
ISERDESE1的级联使用问题 | ponyhk | 1299/0 | 2018年08月17日 19:46:30 by ponyhk |
求VC707配套 高速AD/DA | KKXTT123 | 1297/0 | 2018年08月16日 08:34:16 by KKXTT123 |
ML605 电源管理模块出错 | xilinx论坛 | 1518/1 | 2018年08月13日 09:11:56 by xiachongrongdr |
求助:K7的JTAG接口下载程序报CRC错误。 | wangming169 | 12645/2 | 2018年08月13日 08:50:17 by xiachongrongdr |
Zynq 7020 无法启动 | liumiao199012 | 1387/2 | 2018年08月13日 08:32:21 by xiachongrongdr |
专业维修Xilinx FPGA开发板 | xiachongrongdr | 2005/3 | 2018年08月13日 08:29:30 by xiachongrongdr |
vivado综合后DSP消耗为什么一直显示为 0 | Big13fish | 1539/0 | 2018年07月25日 09:12:57 by Big13fish |
怎么改变FPGA向ARM发出的中断方式?默认貌似是高电平触发,想做成上升沿? | zhizihua209 | 1603/2 | 2018年07月16日 22:41:20 by li52551578 |
想在cpu1上使用pl-ps中断,请问用spi的还是ppi的中断? | simonmao8385 | 5789/2 | 2018年07月16日 22:37:35 by li52551578 |
关于SDx中硬件加速的问题,求大神帮忙! | 幻夜幽莺 | 1726/0 | 2018年05月10日 09:05:04 by 幻夜幽莺 |
ZC706 VADJ电压选择问题 | kiskydiac | 2304/1 | 2018年05月04日 17:18:44 by xiachongrongdr |
求一份ZC706开发板的资料 | silenceF | 1654/2 | 2018年05月04日 17:16:51 by xiachongrongdr |
XC7A50T 各bank电压对地电阻不同 | cnszdz | 2025/1 | 2018年05月04日 16:34:26 by xiachongrongdr |
XILINX产品需求供应 | liqin666888 | 2717/2 | 2018年04月29日 11:10:27 by liqin666888 |
新人报道,请多多关照! | 低调cj | 1046/0 | 2018年04月16日 15:32:32 by 低调cj |
xilinx的以太网sgmi,的ip核,自己总是复位,哪位大神遇到过 | 李大家 | 1307/0 | 2018年03月20日 21:18:44 by 李大家 |
用FPGA能产生1nS的脉冲吗? | JohnZDeng | 1816/0 | 2018年03月06日 16:41:21 by JohnZDeng |
请教下Xilinx器件的数据表中如何换算得到D触发器的数量 | bucker | 1491/0 | 2018年01月24日 18:26:56 by bucker |
更改app1052逻辑,读bar0的数据为0xFFFFFFFF | huanghuan99999 | 1650/1 | 2018年01月06日 16:19:59 by huanghuan99999 |
【求助】debussy编译vivado的ip核报错Actual for formal wea is not a signal | zhanyue1 | 1887/0 | 2017年12月29日 10:37:53 by zhanyue1 |
DDR3 ip的RTL代码移植,vivado与ise版本是否可直接移植 | bobo930805 | 2034/0 | 2017年12月26日 14:59:08 by bobo930805 |
spartan 6 输入时钟倍频后接bufpall,综合place&route通不过 | cuirukai | 1688/1 | 2017年12月26日 11:03:41 by cuirukai |
时序 | xilinx论坛 | 1761/1 | 2017年12月25日 11:26:17 by wu662316 |
AXI quad SPI 使用相关问题 | YueBob | 6150/2 | 2017年11月27日 12:13:59 by godlgxj |
一小批XILINX高端开发板,芯片完好,功能正常,当二手IC卖: | stpx | 2072/0 | 2017年11月04日 11:30:39 by stpx |
FPGA集成电路笔试面试题解答20171012(连载未完) | pkk19870806 | 2737/0 | 2017年10月17日 11:44:51 by pkk19870806 |
请教verilog中流水线的用途? | godjohsn | 2848/2 | 2017年09月30日 17:30:27 by godjohsn |
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求教Xilinx SDK数据存文件的问题 | zhouhy17 | 2079/2 | 2017年09月19日 10:23:44 by zhouhy17 |
Xilinx MPMC NPI接问题 | happylander | 2214/0 | 2017年09月03日 20:18:36 by happylander |
麻烦大家推荐一块FPGA开发板 | ty5656ty | 1989/0 | 2017年08月31日 08:45:21 by ty5656ty |
麻烦问一下 Spartan-6 XC6SLX45-2CSG324可以配置W25Q256FV的flash吗? | yy7576 | 2027/1 | 2017年08月25日 11:40:36 by liqin666888 |
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新手问题请教:iMPACT下载bit文件出现错误 | sinckney | 1925/0 | 2017年08月15日 15:59:49 by sinckney |
请教 | wt877676502 | 1362/0 | 2017年08月14日 17:09:32 by wt877676502 |